Buscas alternativas:
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Assuntos:
“...Adder architectures...”
Avaliação de atraso, consumo e proteção de somadores tolerantes a falhas
Dissertação
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Assuntos:
“...FinFET; reliability; PVT variability; full adder; mitigation technique...”
Avaliação do impacto da variabilidade em circuitos FinFET e an·lise de técnica de mitigação
Dissertação
4
Assuntos:
“...Quantum adder...”
Um circuito quântico para a correlação dos sinais do Arranjo Decimétrico Brasileiro (BDA)
Tese
5
Assuntos:
“...Energy adder circuits...”
Desenvolvimento de um circuito somador de energia para sistemas de colheita híbrida de energia
Dissertação
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“... factors. The advantage of this topology is the possibility of using 4:2 adder compressors, which performs...”
Exploração de operadores aritméticos na transformada rápida de Fourier
Dissertação
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“... Adder (CSA) e somadores compressores. Os principais resultados mostram que o uso de parte da borboleta...”
Otimização de estruturas de borboletas para arquitetura de transformada rápida de Fourier de baixa dissipação de potência
Dissertação
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“... Half-Adder e Full-Adder (Carry and Sum). Para estes circuitos obtemos um CR maior que 5,5 dB, tempo...”
Complementary photonic crystal integrated logic devices and circuits
Tese
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“... for circuitcustomizationisdeveloped,allowingthedesignertouseshapeengineering, leading tothecorrectnessofthestructures.NMLSim2.0testsa4-bitsripplecarry adder usingthismethodology,showingthepotentialofthesoftwareforthesimulation of massivenanomagneticcircuits....”
NMLSim 2.0: uma ferramenta robusta para simulação de circuitos NML pela equação de Landau-Lifshitz-Gilbert
Dissertação
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“... Adder (CSA) foram analizadas. Comparado ao caso que acumula o MVCost após a SAD, reduções média de 17.51...”
Exploring partial distortion elimination techniques in the sum of absolute differences architecture for HEVC integer motion estimation
Dissertação
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“... de potência para topologias com somadores dos tipos CSA (Carry Save Adder) e Ripple carry. Os resultados...”
Decomposição de coeficientes trigonométricos para a redução de área e potência em arquiteturas FFT híbridas na base 2
Tese