Descrição e síntese de uma arquitetura em FPGA para o cálculo de FFT aplicada na geração de imagens SAR

Detalhes bibliográficos
Ano de defesa: 2014
Autor(a) principal: Matheus Torres Alvarenga Silva
Orientador(a): Não Informado pela instituição
Banca de defesa: Não Informado pela instituição
Tipo de documento: Dissertação
Tipo de acesso: Acesso aberto
Idioma: por
Instituição de defesa: Instituto Tecnológico de Aeronáutica
Programa de Pós-Graduação: Não Informado pela instituição
Departamento: Não Informado pela instituição
País: Não Informado pela instituição
Palavras-chave em Português:
Link de acesso: http://www.bd.bibl.ita.br/tde_busca/arquivo.php?codArquivo=3110
Resumo: O trabalho apresentado nessa dissertação teve por foco o estudo de métodos de emprego da Transforma de Fourier, motivado pela aplicação em processadores de radares SAR, propondo descrições em VHDL sintetizáveis. Arquiteturas de acordo com os métodos Decimation In Time e Decimation In Frequency foram propostas e sintetizadas em FPGA, sendo os métodos DIT Radix-4 e DIF Radix-22 SDF estudados em detalhes. O equacionamento matemático foi devidamente apresentado, buscando familiarizar o leitor com formas de abordagem para transformação de DFTs em FFTs. Por fim demonstrou-se as vantagens do método DIF Radix-22 SDF em relação aos demais encontrados na literatura, realizando um maior detalhamento do seu funcionamento e aplicando o mesmo como elemento coprocessador de um processador Narrow Focus para radares SAR. Realizou-se ainda essa etapa de coprocessamento através de comunicação Ethernet também sintetizada em FPGA, apresentando nessa dissertação conceitos básicos sobre este protocolo de comunicação. Os resultados finais são então apresentados a respeito dos tempos de processamento da FFT e dos resultados obtidos em comparação com a transformada obtida pela ferramenta MATLAB, indicando possíveis adaptações a arquitetura proposta, sugerindo trabalhos futuros tanto na área da FFT e processamento de radares SAR, como estudos a respeito da comunicação entre computador e placa FPGA, como foi o exemplo do modelo Ethernet adotado.